篇一 ：数据选择器实验报告
实验三数据选择器
实验人员： 班号： 学号：
一、实验目的
(1) 熟悉并掌握数据选择器的功能。
(2) 用双4选1数据选择器74LS153设计出一个16选1的数据选择器。
(3) 用双4选1数据选择器74LS153 设计出一个全加法器。
二、实验设备
数字电路实验箱，74LS00，74LS153。
三、实验内容
(1) 测试双4选1数据选择器74LS153的逻辑功能。
74LS153含有两个4选1数据选择器，其中
和
为芯片的公共地址输入端，
和
分别为芯片的公共电源端和接地端。Figure1为其管脚图：
Figure 1
按下图连接电路：
Figure 2
(2) 设某一导弹发射控制机构有两名司令员A、B和两名操作员C、D，只有当两名司令员均同意发射导弹攻击目标且有操作员操作，则发射导弹F。利用所给的实验仪器设计出一个符合上述要求的16选1数据选择器，并用数字电路实验箱上的小灯和开关组合表达实验结果。
思路：
由于本实验需要有四个地址输入端来选中16个数据输入端的地址之中的一个，进而实现选择该数据输入端中的数据的功能，即16选1。而公共的、两个地址输入端和
使能端（用于片选，已达到分片工作的目的，进而扩展了一位输入）一共可以提供三个地址输入端，故需要采用降维的方法，将一个地址输入隐藏到一个数据输入端
中。本实验可以降一维，也可以降两位。由于两位比较复杂，本实验选择使用降一维的方式。
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篇二 ：：数据选择器设计(实验报告)
实验报告
一、实验目的
熟悉QuartusⅡ的VHDL文本设计流程全过程，学习简单组合电路的设计、多层次电路设计、仿真和硬件测试。
二、实验设备
GW48系列SOPC/EDA实验开发系统实验箱 一台 计算机 一台
三、实验内容
1首先利用QuartusⅡ完成2选1多路选择器的文本编辑输入(mux21a.vhd)和仿真测试等步骤，给出下图所示的仿真波形。最后在实验系统上进行硬件测试，验证本项设计的功能。
源程序为:
ENTITY mux21a IS
PORT ( a, b, s: IN BIT;
y : OUT BIT );
END ENTITY mux21a;
ARCHITECTURE one OF mux21a IS
BEGIN
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篇三 ：数据选择器实验报告
数据选择器的应用
一．实验目的
1． 了解74LS00，74LS86,74LS153芯片的内部结构和功能；
2． 了解数据选择器的结构和功能；
3． 了解全加器和全减器的结构和功能；
4． 学习使用数据选择器（74LS153）设计全加器和全减器；
5． 进一步熟悉逻辑电路的设计和建立过程。
二．实验原理
1． 数据选择器实现全加器：
列出全加器的真值表：
S真值表：
得到
真值表：
对S的真值表进行降维，得到：
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篇五 ：数据选择器实验报告
数电实验二
姓名：## 学号：## 组别：5
实验题目：数据选择器
实验目的：了解数据选择器的工作原理；
熟悉数据选择器的引脚及其作用；
熟悉数据选择器的工作过程以及学习简单的数据选择器的应用。
实验内容：1：利用两片八选一的数据选择器设计一个十六选一的数据选择器；
实现Y1=m(1,2,4,5)
Y2=(9,10,12)
2:利用十六选一数据选择器设计一个选择器使得输出Y=Y1+Y2=m(6,7,8,11,13)
3:利用八选一数据选择器设计一个红绿灯指示灯，区别红绿灯是否正常。
实验原理：在数字信号的传输过程中，又是需要从一组输入数据中选出某一个来，这时候就需要用到一种称为数据选择器或多路开关的逻辑电路。
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篇六 ：四选一数据选择器实验报告
四选一数据选择器
11微电子 黄跃 1117426021
【实验目的】
1．四选一数据选择器，
2．学习Verilog HDL文本文件进行逻辑设计输入；
3．学习设计仿真工具modelsim的使用方法；
【实验内容】
1. 实现四选一数据选择器的“ Verilog ”语言设计。
2. 设计仿真文件，进行验证。
【实验原理】
数据选择器又称为多路转换器或多路开关，它是数字系统中常用的一种典型电路。其主要功能是从多路数据中选择其中一路信号发送出去。所以它是一个多输入、单输出的组合逻辑电路。
4选1数据选择器的元件符号如图一所示，其中D0、D1、D2、D3是4位数据输入端，A0和A0是控制输入端，Y是数据输出端。当A1A0=00时，输出Y=D1；A1A0=01时，Y=D1；A1A0=10时，Y=D2；A1A0=11，Y=D3。 。
由真值表写出输出逻辑表达式
由逻辑表达式做出逻辑电路图。
【程序源代码】
module mux4_1(sel,in,out);
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篇七 ：数据选择器极其应用实验报告
数据选择器的应用
一、实验目的
了解74LS00，74LS86,74LS153芯片的内部结构和功能；
了解数据选择器的结构和功能；
了解全加器和全减器的结构和功能；
学习使用数据选择器（74LS153）设计全加器和全减器；
进一步熟悉逻辑电路的设计和建立过程。
二、实验原理
1.四选一数据选择器 74LS153
所谓双4选1数据选择器就是在一块集成芯片上有两个4选1数据选择器。引脚排列如图3－3，功能如表3－2。
图3－3 74LS153引脚功能 表3－2
、
为两个独立的使能端；A1、A0为公用的地址输入端；1D0～1D3和2D0～2D3分别为两个4选1数据选择器的数据输入端；Q1、Q2为两个输出端。
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